怎样提升电子产品的抗干扰能力和电磁兼容性

　　在研制带处理器的电子产品时，如何提升抗干扰能力和电磁兼容性？
　　1、 下面的一些系统要特别注意抗电磁干扰
　　（1） 微控制单元时钟频率特别高，总线周期特别快的系统。
　　（2） 系统含有大功率，大电流驱动电路，如产生火花的继电器，大电流开关等。
　　（3） 含微弱模拟信号电路以及高精度A/D 变换电路的系统。
　　2、 为增加系统的抗电磁干扰能力采取如下措施
　　（1） 选用频率低的微控制单元
　　选用外时钟频率低的微控制单元可以有效降低噪声和提升系统的抗干扰能力。同样频率的方波和正弦波，方波中的高频成份比正弦波多得多。虽然方波的高频成份的波的幅度，比基波小，但频率越高越容易发射出成为噪声源，微控制单元产生的最有影响的高频噪声大约是时钟频率的3 倍。
　　（2） 减小信号传输中的畸变
　　微控制单元主要采用高速CMOS 技术制造。信号输入端静态输入电流在1mA 左右，输入电容10PF 左右，输入阻抗相当高，高速CMOS 电路的输出端都有相当的带载能力，即相当大的输出值，将一个门的输出端透过一段很长线引到输入阻抗相当高的输入端，反射问题就很严重，它会引起信号畸变，增加系统噪声。当Tpd〉Tr 时，就成了一个传输线问题，必须考虑信号反射，阻抗匹配等问题。
　　信号在印制板上的延迟时间与引线的特性阻抗有关，即与印制线路板材料的介电常数有关。可以粗略地认为，信号在印制板引线的传输速度，约为光速的1/3 到1/2 之间。微控制单元构成的系统中常用逻辑电话组件的Tr（标准延迟时间）为3 到18ns 之间。
　　在印制线路板上，信号透过一个7W 的电阻和一段25cm 长的引线，在线延迟时间大致在4~20ns 之间。也就是说，信号在印刷线路上的引线越短越好，最长不宜超过25cm。而且过孔数目也应尽量少，最好不多于2 个。
　　当信号的上升时间快于信号延迟时间，就要按照快电子学处理。此时要考虑传输线的阻抗匹配，对于一块印刷线路板上的集成块之间的信号传输，要避免出现Td〉Trd 的情况，印刷线路板越大系统的速度就越不能太快。
　　用以下结论归纳印刷线路板设计的一个规则
　　信号在印刷板上传输，其延迟时间不应大于所用器件的标称延迟时间。
　　（3） 减小信号线间的交叉干扰
　　A 点一个上升时间为Tr 的阶跃信号透过引线AB 传向B 端。信号在AB 在线的延迟时间是Td。在D 点，由于A 点信号的向前传输，到达B 点后的信号反射和AB 线的延迟，Td 时间以后会感应出一个宽度为Tr 的页脉波信号。在C 点，由于AB 上信号的传输与反射，会感应出一个宽度为信号在AB 在线的延迟时间的两倍，即2Td 的正脉波信号。这就是信号间的交叉干扰。干扰信号的强度与C 点信号的di/at 有关，与线间距离有关。当两信号线不是很长时，AB 上看到的实际是两个脉波的迭加。
　　CMOS 工艺制造的微控制由输入阻抗高，噪声高，噪声容限也很高，数字电路是迭加100~200mv 噪声并不影响其工作。若图中AB 线是一模拟信号，这种干扰就变为不能容忍。如印刷线路板为四层板，其中有一层是大面积的地，或双面板，信号线的反面是大面积的地时，这种信号间的交叉干扰就会变小。原因是，大面积的地减小了信号线的特性阻抗，信号在D 端的反射大为减小。特性阻抗与信号线到地间的介质的介电常数的平方成反比，与介质浓度的自然对数成正比。若AB 线为一模拟信号，要避免数字电路信号线CD 对AB 的干扰，AB 线下方要有大面积的地，AB 线到CD 线的距离要大于AB 线与地距离的2~3 倍。可用局部屏蔽地，在有引结的一面引线左右两侧布以地线。